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  • <Data center>資深數位設計工程師 - Ethernet MAC

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 4年工作經驗 4天前更新
    1. Develop Ethernet MAC for HPC networking applications. 2. Work closely with architecture, verification and physical teams from specification to implementation.
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  • <Data center>資深D2D高速介面設計工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 台北市內湖區 4年工作經驗 4天前更新
    1. Develop Die-to-die and UCIe digital IP for HPC SOC. 2. Integration of D2D controller and PHY to timing closure and DFT. 3. Define interface specifications, creating comprehensive verification plans, and support integration and physical implementation. 4. Work closely with multiple teams such as mixed mode designers and Firmware engineers.
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  • O卡桑_門市營運培訓專員

    1日回覆
    O卡桑_日進生技股份有限公司
    食品什貨零售
    面議(經常性薪資達4萬元或以上) 台北市大同區 2年工作經驗 3天前更新
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  • <Data center>資深D2D架構設計師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 台北市內湖區 8年工作經驗 4天前更新
    1. Researching and crafting architecture solutions for die-to-die and chip-to-chip communication, optimizing for performance, area, power, security, and resiliency 2. Working with other design teams to define interfaces and flows between D2D blocks and the rest of the chip 3. Architectural modeling, validation, definition and documentation 4. Driving implementation across design, verification, firmware and software teams
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  • <Data center>通訊系統演算法開發資深工程師/技術副理

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 4天前更新
    1. IEEE 802.3 Ethernet PHY & transceiver architecture & algorithm design 2. Digital signal processing of mixed-signal design 3. System simulation/model design for pre-silicon verification 4. System & algorithm design/simulation of high-speed I/F SerDes 5. Make contribution in standard organizations
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  • <Data center>混合信號數位IC設計工程師(Serdes, 高速介面)

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 4天前更新
    1. Serdes PMA IP architecture planning 2. Serdes PMA IP RTL coding 3. Serdes PMA IP front-end and back-end integration 4. Co-work with PCS and MAC design team and DV team for IP verification 5. Co-work with Analog design team for PHY co-simulation 6. Co-work with Algorithm team for algorithm implementation and bit-true verification
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  • <Data center>系統與量產資深工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 4年工作經驗 4天前更新
    •重點開發技術: 系統軟韌體開發、高速資料實體層(physical layer) 資料傳輸軟體開發、優化硬體效能及產品量產品質控管 •主要目標: 完成Enterprise/AI/xPU等相關產業客製化IC的軟韌體開發與系統整合,並協助客戶產品量產 •負責新產品的系統設計與開發,確保符合公司及客戶的需求 •協助量產過程中的技術問題解決,並提供專業建議以提升生產效率與品質 •與跨部門團隊合作,確保產品從設計到量產的順利過渡 •分析並改善現有系統和流程,以提高產品質量和生產效率 •參與產品測試和驗證,確保產品符合相關標準和規範
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  • <Data center>小封裝技術整合工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 4年工作經驗 4天前更新
    1. 熟悉 2.5D 或是 3D 封裝技術, 開發和量產經驗 2. 從系統架構優劣比較, SIPI 或是測試或是 thermal 角度來提供適合的封裝技術
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  • <Data center>Technology Engineer(3.5D methodology)

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 5年工作經驗 4天前更新
    1. Develop 3.5D methodology from RTL to GDS and Package 2. Coordinate Thermal and PI/SI team to deal with high power design 3. Execute the project at different phases
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  • <Data center>SIPI 工程師/資深工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 2年工作經驗 4天前更新
    1. 高速 SERDES SIPI 分析和整合 2. Core power PI 分析和整合
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  • <Data center>Serdes系統架構研發工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 4天前更新
    1. 高速Serdes系統技術開發(200Gbps+), 包括電通訊與光通訊(optical interconnect) 2. 定義系統技術規格並與設計團隊(Analog, Digital, Algorithm)討論系統架構, 建立模型模擬評估 3. Serdes 關鍵技術評估與開發( e.g., Next Gen Serdes, optical nonlinearity compensation, CPO technology) 4. 協助Serdes IP驗證問題分析
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  • <Data center>Serdes 系統工程師

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹縣竹北市 2年工作經驗 4天前更新
    1. 負責高速 Serdes相關開發, 包含驗證, 客戶支援 (熟悉架構, 韌體、除錯、優化及測試等工作項目) 2. 開發測試自動化 3. 協同團隊共同完成系統雛型建立及性能優化與調適 4. 達成客戶端產品導入,並支援產品量產
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  • <Data center>Senior Signal and Power Integrity Engineer

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 8年工作經驗 4天前更新
    We are looking for a highly experienced PISI Technical Leader to join our team. The ideal candidate will have extensive experience in Power Integrity and Signal Integrity, with a strong background in high-speed IO interface simulations and PDN analysis. As a PISI Technical Leader, you will guide customers through Signal Integrity and Power Integrity signoff, model and optimize system components, and collaborate with various teams to ensure optimal package, PCB, die, interposer, and substrate designs. 1. Guide customers to complete Signal Integrity and Power Integrity signoff. 2. Model and optimize vias, connectors, sockets, breakouts, and various system components using commercial tools. 3. Perform system-level signal integrity simulation in high-speed IOs such as PCIe, SerDes 4. Architect and simulate power delivery systems, including multiple dies, substrate, interposer, PCBs, and on-die PDN models. 5. Collaborate with multiple teams, including layout, design, and customers, to optimize package, PCB, die, interposer, and substrate designs.
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  • <Data center>Power related PCB Design Engineer

    聯發科技股份有限公司
    IC設計相關
    面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 4天前更新
    1.PCB power related hardware design:Resonsible for design and develop hardware including circuit design, component evaluation and selection, customized component planning, layout review, etc. 2. System specification and design requirement collection. 3. System hardware verification and testing: function verification and power quality measurement. 4. Cross-organizational collaboration: Collaborate with IC design team, system team, SI/PI team, layout team, etc. to complete system design, production and verification. 5. Customer and related manufacturer support: including technical document writing, customer reference design support, on site support, etc.
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