• 面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 3天前更新
    工作項目: 大型聯網多媒體SoC整合 應徵條件: 1. 碩士以上,電機工程、電信工程、電控工程、電子工程、自動控制相關科系畢業為主 2. 熟悉Digital IC design flow、RTL coding 3. 熟悉EDA工具:ncverilog, PrimeTime, Design Compiler NXT, LEC, MS-office 4. 具3年以上3年以上相關IC designer工作經驗,如RTL design, verilog simulation, circuit debug, formal check, synthesis, STA等相關經驗者佳 5. 具SoC integration相關經歷者佳
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 7年工作經驗 3天前更新
    工作項目: Business development manager for business and account manager for US customer. 應徵條件: 1. 7 years of experience in sales, marketing, or business development roles, at any company in a semiconductor-related industry. 2. Strong leadership with excellent written and verbal communication skills in English and Chinese. Able to work in a multi-geography and cross-functional organization, and engage with technical and non-technical audiences within customer organization. 3. Detailed-oriented; able to work and thrive under ambiguous situations.
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 2年工作經驗 3天前更新
    工作項目: 1. Customer layout/SCH review 2. IC H/W IP Verification, signal measurement. 3. F/W verification. 4. SSD technical support for customer design-in 5. SSD customer issue analyze and debug 6. cross-team communication and cooperation for customer requirement and issue 7. Product promotion with PM/Sales. 應徵條件: 1. 碩士以上,電機工程、電信工程、電控工程、電子工程、自動控制相關科系畢業為主 2. 熟悉 python 3. 熟悉 PADs/Allegro/OrCAD 4. 具2年以上下列工作經驗:硬體設計工程師, 有ODM/OEM/模組廠工作經驗尤佳, familiar MP flow is a plus. 5. 熟悉oscilloscope, Logical Analyzer, CATC操作 相關經驗者為佳
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 5年工作經驗 3天前更新
    工作項目: 負責伺服器系統管理週邊SoC/ASIC的軟硬體開發驗證/除錯/撰寫,詳細內容如下 1. 晶片系統架構設計: CPU/Platform/IO interface,架構規劃 2. 功能模塊驗證: Security Function, Remote Function, high-speed I/Os. 3. 韌體程式開發: OpenBMC FW, SoC BSP Driver 4. 系統驗證除錯 5. 量產測試設計 應徵條件: 1. 碩士以上,背景電機/資工/電控/自控/資科等科系者佳 2. 具下列條件其一者: a) 伺服器系統週邊晶片系統設計5年以上經驗 b) OpenBMC, DMTF規格軟韌體開發 5年以上經驗 3. 熟悉Server HW management軟硬體;熟BMC FW/DMTF 管理架構者優選 4. 與Server platform venders(e.g., I/A/N...)有長期技術合作經驗者優選
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 5年工作經驗 3天前更新
    工作項目: 1. SSD FTL FW development 2. FW architecture design 4. SSD performance tuning 應徵條件: 1. 碩士以上,電機工程、電信工程、資訊科學相關科系畢業為主 2. 熟悉C語言 3. 具5年以上SSD相關經驗 4. 具備FW architecture design能力 5. 具備SSD Front-end/Back-end/FTL完整經驗
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、電控、資工等相關科系,並具下列任一條件者佳: a. 熟C、C++、Assembly、Linux、SPICE、Matlab、Cadence EDA環境。 b. 熟類比電路設計、數位信號處理及有興趣者。 c. 具ADC、PLL相關經驗及有興趣者。 d. 對通訊網路、聯網多媒體、多媒體、電腦週邊、智慧互聯產品或程式設計有濃厚興趣者。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、電控、資工、資科等相關科系,並具下列任一條件者佳: a. 熟悉C/C++、硬體描述語言(Verilog)和驗證語言(Vera/systemVerilog)。 b. 具IC設計經驗者佳。 c. 對晶片設計驗證或程式設計有濃厚興趣者。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、電控、資工、資科等相關科系,並具下列任一條件者佳: a. 熟悉數位信號處理、數位通信系統。 b. 熟悉於影像系統或數位影像處理,或影像壓縮/解壓縮演算法。 c. 熟悉計算機架構或對SoC設計有興趣者。 d. 具有電路設計、製程整合、元件經驗或有興趣者。 e. 熟悉HDL設計。 f. 對通訊網路、聯網多媒體、多媒體、電腦週邊、智慧互聯、車用電子產品或程式設計有濃厚興趣者。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、通訊、電控、資工、資科等相關科系,並具下列任一條件者佳: a. 對影像處理演算法熟悉或有興趣。 b. 熟悉語音訊號前置處理與語音辨識或有興趣。 c. 對通訊實體層或跨層演算法設計有興趣者,熟通信協定標準者尤佳。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、電控等相關科系,並具下列任一條件者佳: a. 熟悉相關tools(Astro, Encounter, IC Compiler)者。 b. 熟悉IC後段設計流程, 具相關APR經驗及有興趣者。 c. 對於開發及推廣Physical Design Flow有興趣者。 d. 具程式設計(TCL,Perl,C/C++)能力者佳。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、電控、資工及通信等相關科系,並具下列任一條件者佳: a. 熟悉CMOS元件特性。 b. 熟悉SRAM/其他記憶元件特性。 c. 熟悉Hspice, Hsim等simulation tool, Virtuso, Laker等layout tool. d. 對SRAM/其他記憶體電路設計、測試與生產有興趣者。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信等相關科系。 a. 對RF IC設計有興趣者。 b. 熟CMOS/SiGe RF設計及通訊系統經驗尤佳。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上之電子、電機、電信、通訊、電控、資工、資科等相關科系,並具下列任一條件者佳: a. 熟C、C++、Linux、Assembly,具DSP及audio/video processing相關經驗或興趣者。 b. 多媒體影音系統開發經驗或興趣者。 c. 具網路embedded system開發經驗。 d. 熟網路基本概念。 e. 對RF、Microwave, AD/DA, FPGA硬體設計有興趣者。 f. 具實體層數位信號處理設計有興趣,並熟DMT、OFDM或ASIC邏輯線路設計者尤佳。 g. 對通訊網路、聯網多媒體、多媒體、電腦週邊、智慧互聯或車用電子產品之系統韌體或程式設計有濃厚興趣者。
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    應徵條件: 1. 瑞昱強力招募(1)115年度研發替代役及(2)預聘115年應屆畢業之碩士、博士生。 2. 碩士以上;電機、資訊等相關科系,並具下列任一條件者佳: a. 熟悉Verilog RTL、Synthesis、Simulation、Timing Analysis 等相關 IC Design Flow及有興趣者。 b. 熟悉 Design for Testability 技術,包含 Scan / ATPG、Delay Test、Memory BIST、Boundary Scan、Diagnosis 等及有興趣者。 c. 有 DFT Tools (如 DFT Compiler、TetraMAX、BSD Compiler、FastScan、TestKompress、MBISTArchitect) 使用經驗及有興趣者。 d. 積極負責、勇於迎接挑戰,對於 Nanometer / SoC DFT Implementation、開發及推廣設計流程有興趣者。
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