- 面議（經常性薪資達4萬元或以上） 新竹市東區 工作經歷不拘 63天前更新展開
我們在找這樣的你！ (每位應徵者最多可投遞 5 個職缺，提供研發替代役名額) 如果你是 2027 年應屆畢業之碩士或博士生，具備電機、電子、資訊、資工、資管、電信、通訊、電控等相關背景，並對半導體技術、AI 運算、無線通訊、智慧裝置、多媒體平台等領域充滿熱忱，歡迎加入聯發科技，與我們一起打造影響全球的創新科技。 我們期待你樂於學習、勇於挑戰，能主動思考並提出想法，重視團隊合作，面對困難保持好奇心與解決問題的能力，持續突破自我、追求卓越。 在聯發科技，你將與來自世界各地的優秀人才攜手合作，參與全球領先晶片產品的研發，將創新想法轉化為改變世界的技術，共同迎接每一項挑戰。
- 面議（經常性薪資達4萬元或以上） 新竹市東區 工作經歷不拘 35天前更新展開
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- 面議（經常性薪資達4萬元或以上） 台北市內湖區 工作經歷不拘 63天前更新展開
我們在找這樣的你！ (每位應徵者最多可投遞 5 個職缺，提供研發替代役名額) 如果你是 2027 年應屆畢業之碩士或博士生，具備電機、電子、資訊、資工、資管、電信、通訊、電控等相關背景，並對半導體技術、AI 運算、無線通訊、智慧裝置、多媒體平台等領域充滿熱忱，歡迎加入聯發科技，與我們一起打造影響全球的創新科技。 我們期待你樂於學習、勇於挑戰，能主動思考並提出想法，重視團隊合作，面對困難保持好奇心與解決問題的能力，持續突破自我、追求卓越。 在聯發科技，你將與來自世界各地的優秀人才攜手合作，參與全球領先晶片產品的研發，將創新想法轉化為改變世界的技術，共同迎接每一項挑戰。
- 面議（經常性薪資達4萬元或以上） 新竹市東區 4年工作經驗 35天前更新展開
1. IEEE 802.3 Ethernet Electrical/Optical PHY & transceiver architecture & algorithm design 2. Digital signal processing of mixed-signal design 3. System simulation/model design for pre-silicon verification 4. System & algorithm design/simulation of high-speed I/F SerDes 5. Make contribution in standard organizations
- 面議（經常性薪資達4萬元或以上） 新竹市東區 3年工作經驗 63天前更新展開
We are seeking a Senior Customer System & SERDES Engineer to drive system-level debugging and customer issue resolution for 200–400G high-speed interfaces (SERDES, PCS/PMA). You will own end-to-end issue analysis—from triage to root cause and closure—collaborating across cross-functional teams and directly with customers. A key aspect of this role is scaling our debugging operations by building AI-assisted tools (RAG/LLM, log analysis pipelines) and identifying recurring failure patterns. While AI and automation are key enablers, the core focus remains hands-on system debugging and deep technical ownership.
- 面議（經常性薪資達4萬元或以上） 新竹市東區 10年工作經驗 35天前更新展開
You will own the end-to-end technical quality of the HBM memory subsystem (Memory Controller, PHY, and HBM KGSD) for our data center AI silicon — from RTL freeze through high-volume production. You define the quality gates, arbitrate the evidence, and close the loop between pre-silicon predictions and post-silicon reality. This is a high-influence, cross-functional role, partnering daily with design, DV, physical design, SI/PI, DFT/test, package, DRAM suppliers, and OSAT. (1) Pre-silicon quality check includes HBM MC, PHY, and HBM KGSD. (2) Post-silicon production readiness check includes PHY and HBM KGSD test quality.
- 面議（經常性薪資達4萬元或以上） 台中市外埔區 3年工作經驗 今天剛更新展開
1. 規劃與管理模具。 2. 負責生產單位模具、治具異常事項的處理及改善。 3. 負責模具的維修及保養作業。
就業保險產假產檢假家庭照顧假年節獎金 - 面議（經常性薪資達4萬元或以上） 新竹市東區 8年工作經驗 95天前更新展開
1. 4/5/6G modem hardware architecture and digital circuit design task 2. Define hardware architecture of a digital IP/system 3. Include Clock, Bus (AXI/APB/NOC/…), Async design, high speed IF, new IP for sub-sys design topic 4. IP and Subsys digital design and PPA optimization 5. Subsys integration from RTL to gate level including timing closure and testability 6. Design methodology and integration flow improvement
- 面議（經常性薪資達4萬元或以上） 新竹市東區 4年工作經驗 95天前更新展開
1.廠務系統運轉管理(電力,空調,水,消防,IT機房,中央監控等) 2.廠務系統緊急應變處置 3.廠務系統節能減費持續改善 4.因應整改需求之廠務系統規劃,設計,執行 5.員工在廠務相關方面需求之溝通與滿足 6.新建辦公棟機電工程施工進度管理
- 面議（經常性薪資達4萬元或以上） 新竹市東區 2年工作經驗 95天前更新展開
1. 4/5/6G modem Hardware platform IP and Subsys digital design and PPA optimization 2. Define hardware architecture of a digital IP/system: Include Clock, Bus (AXI/APB/NOC/…), Async design, high speed IF, new IP for sub-sys design topic 3. Subsys integration from RTL to gate level including timing closure and testability 4. Design methodology and integration flow improvement
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